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au trigger a muons
 

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LHCb au CPPM

 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 
 

 

 
     
Le but de l'expérience LHCb est l'étude précise de la violation de CP dans tous les couples "particule-antiparticule" contenant un quark beau (mésons beaux). Ces particules seront produites dans les collisions proton-proton, qui auront lieu dans le futur collisionneur hadronique LHC du CERN.
 
 
simulation d'une collision p-p dans laquelle un méson beau est produit

Dans cinq collisions sur mille un couple de mésons beaux est produit. Pour obtenir un lot contenant un grand nombre de mésons beaux, nous étudierons 40 millions de collisions par seconde pendant plusieurs années. Nous devons rejeter, en temps réel, toutes les collisions où ces particules sont absentes. C'est le "trigger" qui est en charge de cette tâche. 

Le "trigger" de LHCb comprend trois étages. Chaque étage utilise des filtres de plus en plus sélectifs. La première étape est purement matérielle : les algortithmes de sélections sont gelés dans des cartes d'électronique spécifiques (processeurs cablés). Les deux autres étapes sont plutôt de type logicielles, les algorithmes tournant sur des fermes de PC.

Nous préparons LHCb en développant un des processeurs cablés de premier niveau. Il selectionne en temps réels les événements très rares qui contiennent un méson beau en détectant la présence d'un muon à grande impulsion transverse.

       
  • Synopsis du trigger à muon :
    • Recherche dans les 5 plans de mesure du détecteur à muons (M1, M2, M3, M4, M5), d'un segment de trace rectiligne provenant du point d'interaction.
    • Calcul de l'impulsion transverse de chaque candidat, à partir du point d'impact dans le premier plan de mesure et de l'angle d'incidence.

    •  
  • Caractèristiques techniques :
    • Taille d'un événement : 27 kilobits
    • Nombre d'événements par seconde : 40 000 000
    • Temps de calcul par événement : 1.2 microseconde
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  • Technologies :
    • Architecture pipepline et parallèle
    • Liaisons optiques à haut débit : 1.6 Gigabits par seconde
    • Dernière géneration de FPGA (~900 Entrées/Sorties)
    • Fond de panier spécialisé (LVDS, GTL+,...)

     
     


    Dernière mise à jour : Mardi 30 mai 2000 - © CPPM-IN2P3-CNRS 2000